طراحي PLL دو حلقه اي مبتني بر آشكارسازي فاز پنجره اي با سرعت قفل بالا، توان مصرفي و اسپور مرجع پايين

A Dual-Loop PLL Based on Aperture-Phase Detection, with Short Locking Time, Low Power, and Low Spur

در اين مقاله حلقه قفل فاز دو حلقه اي با سرعت قفل بالا، توان مصرفي پايين و اسپور مرجع پايين ارائه شده است. فركانس خروجي مدار طراحي شده 3.2 GHz و فركانس مرجع 50 MHz مي باشد و مناسب براي كاربرد وايمكس مي باشد. در اين طراحي پس از قفل نهايي قسمتي از مدار تاثيري در عملكرد مدار نداشته و مي توان آنها را غيرفعال كرد، لذا توان مصرفي بسيار پايين مي باشد. روش آشكارسازي فاز، آشكارسازي پنچره اي است. ساختار پمپ بار پيشنهادي به گونه اي مي باشد كه سبب كاهش اسپور مرجع مي شود. همچنين از يك ساختار جديد حلقه قفل فركانس، جهت كاهش زمان قفل حلقه استفاده شده است.شبيه سازي مدار پيشنهادي با استفاده از بسته طراحي تكنولوژي 0.18 µm CMOS-RF انجام شده است. در ساختار پيشنهادي اسپور مرجع برابر با -74dBc ، زمان قفل 1.9 µs و توان مصرفي 4.15 mw حاصل شده است.

In this paper، a dual loop PLL with short locking time، low power consumption and low reference spur is presented. The output frequency and reference frequency of the designed circuit are 3.2 GHz and 50 MHz، respectively، aimed to WiMAX applications. In the proposed circuit in locked state، some parts of the circuit could be powered off، to reduce overall power consumption. Phase detection in the circuit is based on Aperture Phase Detection (APD) method. In addition، the proposed charge pump reduces reference spur. The proposed structure of the frequency locked loop reduces the locking time. To evaluate the proposed approch، we simulated the designed PLL using the foundry design kit for 0.18μm CMOS technology. The spur level and lock time of the proposed circuit is -74dBc and 1.9 μs، respectively، implying 5dB improvement in spur level and 32% improvement in lock time compared with the previously proposed circuits. The power consumption of the proposed circuit is 4.15 mW.